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题解

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全部文章 / 题解（共74篇）

题解 | #位拆分与运算#

题意整理 1、寄存器的位是可以分开单独运算的，并不是一个输入就一定是一个数据，在很多情况下，一个输入既包括数据又包括地址等其他有效信息 2、需要考虑数据锁存的问题，一定要在sel为0的时候进行锁存，只有此时的写入才是有效的（validout的下降沿写入有效），同时存在多种情况且没有优先...

Verilog

2022-03-03

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题解 | #移位运算与乘法#

题意整理 1、在硬件中进行乘除法运算是比较消耗资源的一种方法，想要在不影响延迟并尽量减少资源消耗，必须从硬件的特点上进行设计。根据寄存器的原理，由于是二进制，所以进位和退位为x2或者/2，同样除7可以使用进位3然后减去本身的做法，这样就将乘除法运算转化为位运算，这是一种比较简单的整数运算处理...

Verilog

2022-03-03

92 5972

题解 | #奇偶校验#

题意整理 1、简单理解奇偶校验奇校验：原始码流+校验位总共有奇数个1 偶校验：原始码流+校验位总共有偶数个1 2、计算奇偶校验的方法按位求异或得到奇校验结果，对其求反得到偶校验结果 3、连续进行异或 odd = ^bus &nb...

Verilog

2022-03-03

54 4057

题解 | #四选一多路器#

题意整理本题要求设计一个四选一的多路器，注意输出的定义是线网类型，因此不能使用always组合逻辑块，但是实际上，在语言中使用reg并不一定会被综合成寄存器。题解主体可以得到状态转换： d0 11 d1 &nb...

Verilog

2022-03-03

46 4048