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FPGA数字IC笔试面试系列

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FPGA数字IC笔试100道题

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全部文章（共18篇）

题解 | 基础版07#求两个数的差值#

本题目虽然简单，但是值得探究if...else仿真时的注意点，笔试遇到过，你不一定能答对哦~ 1. 题目根据输入信号a,b的大小关系，求解两个数的差值：输入信号a、b为8bit位宽的无符号数。如果a>b，则输出a-b；如果a≤b...

2022-04-20

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题解 | 基础版06#多功能数据处理器#

本题目虽然简单，但是值得探究有符号数和无符号数问题，笔试面试和实际项目常见的问题，建议学习。 1. 题目根据指示信号select的不同，对输入信号a,b实现不同的运算。输入信号a、b为8bit有符号数，当select[1;0] =0，输出a； ...

2022-04-20

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题解 | 基础版05#位拆分与运算#

作者：FPGA探索者链接：https://www.nowcoder.com/discuss/936631?source_id=profile_create_nctrack&channel=-1 来源：牛客网 1. 题目输入16位数据d[15:0]，按照sel选择输出...

2022-04-20

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题解 | #移位运算与乘法#

1. 题目已知d为一个8位数，请在每个时钟周期分别输出该数乘1/3/7/8，并输出一个信号通知此时刻输入的d有效（d给出的信号的上升沿表示写入有效）。 2. 解析 2.1 移位运算实现乘法 2.2...

2022-04-20

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题解 | #奇偶校验#

作者：FPGA探索者链接：https://www.nowcoder.com/discuss/936631?source_id=profile_create_nctrack&channel=-1 来源：牛客网 1. 解析 1.1 ...

2022-04-20

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题解 | #异步复位的串联T触发器#

T触发器：输入是1，输出翻转；输入是0，输出保持；两个这种T触发器串联起来，第一个的输出作为第二个的输入。 `timescale 1ns/1ns module Tff_2 ( input wire data, clk, rst, output reg q ); // 1. ...

2022-04-13

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题解 | #四选一多路器#

两种解法： 1. 在always块内赋值，使用case语句或者if...else语句注意always块内赋值，要把变量声明为reg类型 `timescale 1ns/1ns module mux4_1( input [1:0]d1,d2,d3,d0, ...

2022-04-13

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题解 | #多功能数据处理器#

有符号数，输入8-bit，输出9-bit，最好是手动扩展符号位再输出，加、减操作时也是手动扩展符号位再加减。 // Verilog 使用位拼接，扩展符号位 // 作者：FPGA探索者 `timescale 1ns/1ns module data_select( input clk, input ...

2022-03-14

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