牛客157503732号
牛客157503732号
全部文章
分类
归档
标签
去牛客网
登录
/
注册
牛客157503732号的博客
全部文章
(共6篇)
题解 | #游戏机计费程序#(三段式状态机)
`timescale 1ns/1ns module game_count ( input rst_n, //异位复位信号,低电平有效 input clk, //时钟信号 input [9:0]money, input set, inp...
2022-12-09
0
0
题解 | #交通灯#(采用三段式状态机)
注意的点:1.交通灯是按红——黄——绿——红这样的顺序来循环变化的2.复位之后需要延迟两个时钟再跳转到红灯,当处在延时暂停态时,三盏灯均不亮3.红灯倒计时10-1,黄灯倒计时5-1,绿灯倒计时60-1(行人按钮没有按下时)4.用次态(nstate)来判断灯的状态,采用现态(state)来判断的话,灯...
2022-12-09
8
1184
题解 | #RAM的简单实现#
需要注意的点:1.题目要求的是双端口RAM,执行的读写操作互不干扰,因此需要写两个always块2.采用for循环语句对RAM进行初始化,不能写成RAM[addr] <= 'b0的形式总体代码`timescale 1ns/1ns module ram_mod( input clk, inp...
2022-12-08
0
310
题解 | #简易秒表#
`timescale 1ns/1ns module count_module( input clk, input rst_n, output reg [5:0]second, output reg [5:0]minute ); always @(posedge clk ...
2022-12-08
0
241
题解 | #脉冲同步电路#
//总体代码 `timescale 1ns/1ns module pulse_detect( input clk_fast , input clk_slow , input rst_n , input data_in , output ...
Verilog
2022-12-08
0
265
题解 | #多bit MUX同步器#
`timescale 1ns/1ns module mux( input clk_a , input clk_b , input arstn , input br...
Verilog
2022-12-07
0
309